// this file is generated by topld.pl // please don't edit it. // input pins // output pins // internal nodes // code nodes // equations // c1: c_us // c2: c_us // c3: c_us // c4: c_us // c5: c_us // c6: c_us // c7: c_us // c8: c_us // c9: cpol_use // c10: cpol_use // e1: sn74h40 module m611a (n3v3, n_t_10x, n_t_11x, n_t_12x, n_t_13x, n_t_14x, n_t_15x, n_t_16x, n_t_17x, n_t_18x, n_t_19x, n_t_1x, n_t_20x, n_t_21x, n_t_22x, n_t_23x, n_t_24x, n_t_25x, n_t_26x, n_t_27x, n_t_28x, n_t_2x, n_t_3x, n_t_4x, n_t_5x, n_t_6x, n_t_7x, n_t_8x, n_t_9x); input n3v3; output n_t_10x; input n_t_11x; output n_t_12x; input n_t_13x; output n_t_14x; input n_t_15x; output n_t_16x; input n_t_17x; output n_t_18x; input n_t_19x; input n_t_1x; output n_t_20x; input n_t_21x; output n_t_22x; input n_t_23x; output n_t_24x; input n_t_25x; output n_t_26x; input n_t_27x; output n_t_28x; output n_t_2x; input n_t_3x; output n_t_4x; output n_t_5x; input n_t_6x; input n_t_7x; output n_t_8x; input n_t_9x; assign n_t_4x = ~(n3v3 & n_t_3x); assign n_t_2x = ~(n_t_1x & n3v3 & n3v3 & n3v3); // e2: sn74h40 assign n_t_5x = ~(n3v3 & n_t_6x); assign n_t_10x = ~(n_t_9x & n3v3 & n3v3 & n3v3); // e3: sn74h40 assign n_t_8x = ~(n3v3 & n_t_7x); assign n_t_12x = ~(n_t_11x & n3v3 & n3v3 & n3v3); // e4: sn74h40 assign n_t_14x = ~(n3v3 & n_t_13x); assign n_t_16x = ~(n_t_15x & n3v3 & n3v3 & n3v3); // e5: sn74h40 assign n_t_20x = ~(n3v3 & n_t_19x); assign n_t_18x = ~(n_t_17x & n3v3 & n3v3 & n3v3); // e6: sn74h40 assign n_t_24x = ~(n3v3 & n_t_23x); assign n_t_22x = ~(n_t_21x & n3v3 & n3v3 & n3v3); // e7: sn74h40 assign n_t_28x = ~(n3v3 & n_t_27x); assign n_t_26x = ~(n_t_25x & n3v3 & n3v3 & n3v3); // open collector 'wire-or's endmodule